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提出一種新的高階FIR濾波器的FPGA實(shí)現(xiàn)方法。該方法運(yùn)用多相分解結(jié)構(gòu)對(duì)高階FIR濾波器進(jìn)行降階處理，采用改進(jìn)的分布式算法來實(shí)現(xiàn)降階后的FIR濾波器。設(shè)計(jì)了一系列階數(shù)從8到1 024的FIR濾波器，通過Quartus II 7．1的綜合與仿真，以及在EP2S60F1020C4 FPGA目標(biāo)器件上的實(shí)現(xiàn)結(jié)果表明，該方法能夠有效地減少硬件資源的使用且滿足高速實(shí)時(shí)性的要求。
FIR濾波器因其具有線性相位、穩(wěn)定等優(yōu)點(diǎn)，在軟件無線電、數(shù)字雷達(dá)、移動(dòng)通信、醫(yī)療儀器等領(lǐng)域有廣泛的應(yīng)用，一直是大家研究的焦點(diǎn)。FPGA是物理級(jí)編程結(jié)構(gòu)的可編程邏輯器件，其基本結(jié)構(gòu)由4輸入的查找表構(gòu)成，如何在FPGA上實(shí)現(xiàn)高階高效FIR濾波器成為—個(gè)很現(xiàn)實(shí)的問題。
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