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Versal 產品組合基于 臺積電(TSMC)的 7 nm FinFET 工藝技術,是第一個將軟件可編程性與特定領域硬件加速和靈活應變能力相結合的平臺,這對于跟上當今快速的創新步伐至關重要。
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AMD Versal自適應SoC器件Advanced Flow概覽(下)
在 AMD Vivado Design Suite 2024.2 版本中,Advanced Flow 自動為所有 AMD Versal 自適應 SoC ...
AMD Versal自適應SoC器件Advanced Flow概覽(上)
在最新發布的 AMD Vivado Design Suite 2024.2 中,引入的新特性之一是啟用了僅適用于 AMD Versal 自適應 SoC ...
AMD Versal自適應SoC DDRMC如何使用Micron仿真模型進行仿真
AMD Versal 自適應 SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時,按照 IP 的默認設置,在 IP wizard 中使能了“In...
AMD 通過第二代 Versal 器件為 AI 驅動型嵌入式系統提供單芯片智能
隨著嵌入式 AI、視頻和控制應用的爆炸式增長,對異構處理的需求越來越大,以便在狹小的區域和功率限制內加速端到端計算。多芯片處理解決方案具有巨大的功耗、面...
AMD Versal自適應SoC GTM如何用XSIM仿真和觀察PAM4信號
PAM4(4-Level Pulse Amplitude Modulation) 的全稱是四電平脈沖幅度調制,通過種不同的電平進行信號傳輸,每個電平幅度...
【ALINX 技術分享】AMD Versal AI Edge 自適應計算加速平臺之 Versal 介紹(2)
【ALINX 技術分享】AMD Versal AI Edge 自適應計算加速平臺之 Versal 介紹,以及Versal 芯片開發流程的簡介。
Versal GTM如何用Tcl命令在IBERT生成QPRBS13序列
目前對于 Vivado 2023.1 版本的 IBERT GUI 界面暫時不支持 QPRBS13 的設置,需要通過 tcl 或者端口設置的方法來實現。
本文涵蓋了有關使用 PetaLinux 命令行來對 Versal? ACAP 的 PetaLinux BSP 運行 QEMU 的信息
Versal ACAP DDRMC-DDR4、LPDDR4和LPDDR4X外部參考時鐘設計指南
本文旨在呈現使用 DDR4、LPDDR4 或 LPDDR4X 存儲器控制器的 Versal ACAP 器件的外部參考時鐘電路要求
Versal Premium SysMon:如何在輔助SLR中對SysMon寄存器進行尋址
要在輔助 SLR 中啟用對 Sysmon 寄存器空間的訪問,須在 CIPS 和 NOC GUI 執行多個步驟
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