資料介紹
從根本上講,復(fù)雜系統(tǒng)級芯片的測試與驗證問題與CMOS技術(shù)以前一直推測的物理極限存在沖突。在設(shè)計系統(tǒng)級芯片時,設(shè)計人員需要處理數(shù)百萬門線路的設(shè)計,但即使解決了復(fù)雜的線路設(shè)計,設(shè)計好的電路仍然需要進(jìn)行驗證和測試,這時候就會出現(xiàn)半導(dǎo)體物理方面的問題,為已十分復(fù)雜的系統(tǒng)增添許多不希望看到的物理效應(yīng)。為此,驗證和測試技術(shù)人員不得不急切地開發(fā)新工具和技術(shù),以克服0.18μm及更微細(xì)工藝所帶來的新難題
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