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鎖相環(huán)（PLL）是集成電路中非常重要的模塊，常常用來實現(xiàn)時鐘倍頻，時鐘綜合，抖動衰減，數(shù)據(jù)時鐘恢復(fù)等功能。PLL是一個非線性的離散系統(tǒng)，很難準(zhǔn)確刻畫。在一定的條件下——開環(huán)帶寬小于參考頻率的1/10——可以把它作為一個線性系統(tǒng)來近似處理。在行為級，或稱系統(tǒng)級，工程師可以用一些輔助工具如Matlab或Verilog-A，來實現(xiàn)PLL的模型。在將行為級的模型細(xì)化為晶體管級的電路時，工程師們一般是把PLL的各個子模塊分別設(shè)計和刻畫，再用線性模型把它們組合在一起，得到各種環(huán)路參數(shù)。其中的原因有兩個：一是線性模型的準(zhǔn)確性很高，能夠滿足工程的需要；二是整個PLL一起仿真時，對硬件和軟件的要求都很高：單單一個瞬態(tài)仿真，在滿足精度和功能兩個條件下，就要花費數(shù)小時，甚至數(shù)天，更別說要仿真環(huán)路參數(shù)了。這樣的代價在工程開發(fā)中是不可接受的。
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