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本文提出了一種低壓工作的高速10bit Pipelined ADC。采用自舉時鐘采樣和Cascode
頻率補償?shù)确椒ǎ?a target='_blank' class='arckwlink_none'>ADC可以在低電壓下工作，并達到較高的帶寬。該ADC在HJTC 0.18-μmCMOS 數(shù)模混合工藝下進行了設計仿真和流片測試，結果表明：當供電電壓為1.8 V，采樣頻率為62.5MSample/s 時，所設計的ADC 對于1MHz 的輸入信號轉換有效位數(shù)可以達到
52.2dB SFDR、44.8dB SNR 和44.3dB SNDR。
關鍵詞：Pipelined ADC；低壓；CMOS
頻率補償?shù)确椒ǎ?a target='_blank' class='arckwlink_none'>ADC可以在低電壓下工作，并達到較高的帶寬。該ADC在HJTC 0.18-μmCMOS 數(shù)模混合工藝下進行了設計仿真和流片測試，結果表明：當供電電壓為1.8 V，采樣頻率為62.5MSample/s 時，所設計的ADC 對于1MHz 的輸入信號轉換有效位數(shù)可以達到
52.2dB SFDR、44.8dB SNR 和44.3dB SNDR。
關鍵詞：Pipelined ADC；低壓；CMOS
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