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設計了以CPLD 為核心處理芯片的多路數據采集系統，按照正確的時序直接
控制AD676和雙端口RAM的工作, 所有這些功能都采用VHDL語言進行描述。
關鍵詞：CPLD, AD676, VHDL語言, 雙端口RAM，數據采集
在數字技術飛速發展的今天, 將各種模擬信號轉化為數字信號再進行相應的處理, 不
僅可以提高系統性能, 還可以充分利用現代信號的各種處理算法。以往的多通道數字采集系統多數采用單片機、DSP等微處理器產生A/D轉換芯片所需要的控制時序，以及通道轉換所需要的時序邏輯信號，這樣會占用CPU較多的時間，特別在有語音、圖像處理的應用場合會影響整個系統的信號處理速度。
隨著工藝水平的不斷進步, 可編程器件CPLD (Complex Programmable Logical Device)
的速度和規模都有了很大的提高, 而且, 它們還具有集成度高、體積小、功耗低、設計靈活等優勢, 這就為利用可編程器件實現高速的信號采集和處理開辟了道路。本文介紹基于CPLD的多通道數據采集系統設計方法，所需控制時序及地址譯碼等電路均有CPLD產生，并將轉換結果放于雙端口RAM中，CPU可隨時從雙端口RAM讀取，以實現高速數據采集和處理。
控制AD676和雙端口RAM的工作, 所有這些功能都采用VHDL語言進行描述。
關鍵詞：CPLD, AD676, VHDL語言, 雙端口RAM，數據采集
在數字技術飛速發展的今天, 將各種模擬信號轉化為數字信號再進行相應的處理, 不
僅可以提高系統性能, 還可以充分利用現代信號的各種處理算法。以往的多通道數字采集系統多數采用單片機、DSP等微處理器產生A/D轉換芯片所需要的控制時序，以及通道轉換所需要的時序邏輯信號，這樣會占用CPU較多的時間，特別在有語音、圖像處理的應用場合會影響整個系統的信號處理速度。
隨著工藝水平的不斷進步, 可編程器件CPLD (Complex Programmable Logical Device)
的速度和規模都有了很大的提高, 而且, 它們還具有集成度高、體積小、功耗低、設計靈活等優勢, 這就為利用可編程器件實現高速的信號采集和處理開辟了道路。本文介紹基于CPLD的多通道數據采集系統設計方法，所需控制時序及地址譯碼等電路均有CPLD產生，并將轉換結果放于雙端口RAM中，CPU可隨時從雙端口RAM讀取，以實現高速數據采集和處理。
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