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DRA79x 處理器采用 538 焊球、17mm x 17mm、0.65mm 焊球間距（0.8mm 間距規(guī)則可用于信號）（通過 Channel™ 陣列 (VCA) 技術(shù)實現(xiàn)）、球柵陣列 (S-BGA) 封裝。 此架構(gòu)旨在昨用經(jīng)濟高效的解決方案，為汽車協(xié)處理、混合無線電和放大器應用提供高性能并發(fā)性 ， 實現(xiàn) DRA75x（“Jacinto 6 EP”和“Jacinto 6 Ex”）、DRA74x“Jacinto 6”、DRA72x“Jacinto 6 Eco”和 DRA71x“Jacinto 6 Entry”信息娛樂處理器系列的全面可擴展性。 采用配有 Neon™ 擴展組件的單核 Arm Cortex-A15 RISC CPU 和 TI C66x VLIW 浮點 DSP 內(nèi)核，可提供 編程功能。借助 Arm 處理器，開發(fā)人員能夠?qū)⒖刂坪瘮?shù)與在 DSP 和協(xié)處理器上編程的其他算法分離開來， 從而降低系統(tǒng)軟件的復雜性。 此外，TI 提供了一整套針對 Arm 和 DSP 的開發(fā)工具，其中包括 C 語言編譯器和一個可查看源代碼執(zhí)行情 況的調(diào)試界面。
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