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提出了一種適合FPGA高效運(yùn)算的專用進(jìn)位鏈結(jié)構(gòu)。基于應(yīng)用范圍方面的考慮，我們先對(duì)典型的行波進(jìn)位做了一定的改進(jìn)，目的是增強(qiáng)邏輯模塊的功能實(shí)現(xiàn)能力和提高運(yùn)算速度。提出進(jìn)位鏈設(shè)計(jì)的策略，設(shè)計(jì)一種基于高效加法器像選擇進(jìn)位、超前進(jìn)位的進(jìn)位新結(jié)構(gòu)。結(jié)果表明這種優(yōu)化設(shè)計(jì)提高了芯片的運(yùn)算速度，同時(shí)比現(xiàn)有的結(jié)構(gòu)要快2倍左右。
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