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隨著市場智能手機平臺和平板電腦對芯片性能和上市時間要求的不斷提升，后端工程師面臨的設計壓力會越來越大。傳統的數字實現流程在滿足當今 SoC 設計的功耗、頻率與面積要求方面正在達到極限。那如何在很短的時間內迅速實現芯片功耗、頻率與面積的提升變的尤為重要。
本文基于 SMIC 40nm 低功耗工藝的 ARM Cortex A9 物理設計的實際情況，詳細闡述了如何使用 cadence 最新的時鐘同步優化技術，又稱為 CCopt 技術來實現統一的時鐘樹綜合和物理優化。根據實現的結果來看，CCopt 引擎很好的實現了目標。實現 8%的設計頻率提升，并實現了時鐘樹功率與面積降低。Cadence 最新的 CCopt 引擎對實現復雜芯片物理設計、縮短設計周期、提升芯片性能帶來了很大的優勢。
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