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實驗原理
CPLD芯片產生8位二進制循環加法計數值D7～D0，它們與AD558數據端相連，使DA轉換產生0～2.56V的斜波電壓，經一級運放放大一倍后成為0～5.12V（理論值，實際的動態范圍是0～3.78V左右，在高就飽和位3.78V）。
可變電阻器模擬0～5V的模擬輸入量，這個值被接入另一個運放的反向輸入端，而DA轉換放大的0～5.12V的電壓量被接入運放的同相輸入端，比較器運放的輸出端接CPLD的輸入管腳jmp。
工作時，可變電阻器輸入一個Vtest值，而DA轉換從0～5.12V循環掃描，當掃描值Vscan低于Vtest時，比較器輸出的jmp為“0”，當掃描值Vscan高于Vtest時，比較器輸出為“1”，而使jmp產生正向跳變的DA轉換的數字量輸入值DAOUT就代表模擬量Vtest的數值。
顯示用習慣的十進制，并在芯片內部完成兩倍顯示轉換。
以上各模塊的大部分連線都已接好，只有個別端以適應實驗的靈活性。
參考原理圖如圖12-1所示
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