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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>TPS3838J25,pdf(Nanopower Super

      TPS3838J25,pdf(Nanopower Super

      2010-10-26 | rar | 612 | 次下載 | 5積分

      資料介紹

      The TPS3836, TPS3837, and TPS3838 families of supervisory circuits provide circuit initialization and timing supervision, primarily for DSP and processor-based systems.

      During power-on, RESET is asserted when the supply voltage VDD becomes higher than 1.1 V. Thereafter, the supervisory circuit monitors VDD and keeps the RESET output active as long as VDD remains below the threshold voltage of VIT. An internal timer delays the return of the output to the inactive state (high) to ensure proper system reset. The delay time starts after VDD has risen above the threshold voltage VIT.

      When CT is connected to GND, a fixed delay time of typical 10 ms is asserted. When connected to VDD, the delay time is typically 200 ms. When the supply voltage drops below the threshold voltage VIT, the output becomes active (low) again.

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