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系統級節電與功率預算優化是許多應用的關鍵。例如，數據中心運營商努力控制能耗，便攜式設備設計人員力圖降低流耗實現更長的電池使用壽命，而通信系統則需要降低工作溫度提高穩定性。電源設計主要規范的當前著眼點是：
1）在整個負載電流范圍內最大限度提高效率；和
2） 根據負載需要自適應縮放輸出電壓
使用電壓識別（VID） 調節輸出電壓是滿足這些需求的方法之一。當然，在英特爾和AMD 提供的眾所周知的自適應電壓縮放（AVS） 規范基礎上，VID 可編程性已經在微處理器應用的DC/DC 內核電壓穩壓器中得到了廣泛使用。然而，這些VID 控制器建立在多相位降壓拓撲基礎之上，在特性上專門圍繞超大電流需求進行了定制。
DSP、FPGA 以及ASIC 現在具有類似的功能，可根據器件活動、電源及時鐘域配置、工作模式以及工作溫度，實現最大限度的功耗降低。雖然支持VID［1］ 的數字化脈寬調制器（PWM） 控制器解決方案可用來滿足這一需求，但確實也需要對無處不在地模擬控制負載點（POL） 穩壓器進行輸出電壓數字化調節。在調節過程中，可輕松調整模擬電源實施（或許已經完成設計或已經通過測試臺測試），滿足其它方案無法實現的系統級功率預算與成本目標要求。
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