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首先說明一下，Altium Designer的Protel中進行 FPGA設計可以采用：語言設計輸入，原理圖符號設計輸入或者混合輸入。象大多數FPGA設計軟件一樣，我們推薦用戶采取層次化的設計方式：底層設計，上層例化（調用）。在底層用語言或原理圖符號設計好一個個文件，并將這些文件生成圖表符，上層在原理圖的環境中將這些代表各個文件的圖表符連接起來，并且可以使用我們提供的各種免費的模塊（如虛擬儀器，處理器，外設等），來完成設計與測試。下面的例子中，我們對一個VHDL文件進行仿真，當然，我們也可以對原理圖文件建立Testbench 進行仿真。
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