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SDRAM與DDR布線指南:ecos應用是與硬件平臺無關的，雖然開發板沒有涉及到SDRAM和DDR，不過，在某些高端平臺上使用ecos可能會遇到內存布線問題，為了完整敘述，這里一并給出說明。 很多人對內存布線感到迷茫，找不到切入點，不知如何下手，其實高速硬件設計的主要任務就是與干擾做斗爭，內存布線也不例外。可以這樣考慮：內存是做什么用的呢？是用來存儲數據的，寫入1讀出1，寫入0讀出0，即保證數據訪問正確。那么，在什么情況會導致數據訪問錯誤呢？ 1、判決錯誤，0判成1，1判成0。可能參考電平不準(為什么不準？信號線內阻造成的壓降)，也可能是加性干擾，或者阻抗不匹配引起信號畸變。 2、時序錯誤，不滿足建立/保持時間，或者采樣點相位錯誤，不在有效信號位置上。觸發器需要維持一段時間的能量供給才能正常工作，這個時間就是建立/保持時間。 那么只要解決好這兩個問題，保證內存正確訪問，你的內存電路就設計成功了。 有了這個指導思想，內存布線就可以按部就班地完成。不過，不同的RAM類型，雖然目標都是避免判決和時序錯誤，但實現方法因工作模式不同而有較大差異。
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