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隨著衛(wèi)星技術和星上有效載荷技術的發(fā)展，衛(wèi)星數(shù)傳系統(tǒng)對信息傳輸速率的要求也越來越高，從過去的kbps 提高到目前幾百Mbps，末來高速數(shù)傳系統(tǒng)傳輸速率將達G 量級。隨著傳輸速率的提升，如何實時處理高速數(shù)據(jù)成為關鍵。
美國JPL 實驗室在97 年提出了APRX 結(jié)構(gòu)，采用并行結(jié)構(gòu)實現(xiàn)高速全數(shù)字解調(diào)，國內(nèi)也有許多針對高速數(shù)據(jù)解調(diào)方面的研究|。并行結(jié)構(gòu)的解調(diào)器中的匹配濾波器個數(shù)與并行路數(shù)成比，資源消耗巨大，且位同步數(shù)據(jù)抽取需要大量選擇開關，成為FPGA 實現(xiàn)的一個難點。研究了并行結(jié)構(gòu)的頻域匹配濾波器設計，給出了一種頻域并行解調(diào)結(jié)構(gòu)。文中將匹配濾波與位同步相結(jié)合，通過實時更新濾波器系數(shù)，同時實現(xiàn)濾波、內(nèi)插、抽取功能，濾波器組輸出速率降低為符號速率。降低了并行結(jié)構(gòu)中匹配濾波器的數(shù)量，從而達到減少資源消耗的目的。給出了濾波器系數(shù)的計算過程及具體方法，分析了該結(jié)構(gòu)的資源消耗情況。
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