基于FPGA的數字時鐘設計
本次的設計的數字鐘思路描述如下，使用3個key按鍵，上電后，需要先配置數字時鐘的時分秒，設計一個按鍵來控制數字時鐘的時，第二個按鍵來控制數字時鐘的分，本次設計沒有用按鍵控制數字時鐘的秒，原理一樣，大家可以自己做拓展設計再使用一個按鍵控制數字時鐘的，然后用第三個按鍵來控制數字時鐘的運行。采取"Top to down"設計思想，分模塊設計，由于本次設計比較簡單，這里就沒有設計總設計框架圖，上面也大致描述了設計思路，給大家截取RTL級視圖提供參考，具體設計如下：
附設計代碼：（源碼文件可從公眾號內部獲取） 總模塊：
按鍵模塊：
消抖模塊：
數碼管模塊：
控制模塊：
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原文標題：源碼系列：基于FPGA數字時鐘的設計（附源工程）
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