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Xilinx UltraScale+ 器件集成 MIPI D-PHY

C29F_xilinx_inc ? 來(lái)源:互聯(lián)網(wǎng) ? 作者:佚名 ? 2017-09-20 17:56 ? 次閱讀

無(wú)論您正在設(shè)計(jì)的處理系統(tǒng)是用于汽車、物聯(lián)網(wǎng),還是用于 VR/AR 應(yīng)用,符合 MIPI 標(biāo)準(zhǔn)的傳感器及顯示器均是實(shí)現(xiàn)可擴(kuò)展性、高抗噪性及高抖動(dòng)容限的必要條件。此外,他們的高速度和低功耗模式也是獲得最佳功耗性能平衡的關(guān)鍵。然而,使用外部橋接器芯片或 PHY 會(huì)增加材料清單成本(BOM),甚至?xí)谀承?yīng)用中引起合規(guī)性問題。為此,可借助集成 1.5Gb/s MIPI 標(biāo)準(zhǔn) I/O 的 Zynq UltraScale+ MPSoC 和 Kintex UltraScale+ FPGA 等符合 MIPI 標(biāo)準(zhǔn)的處理平臺(tái)移除外部 MIPI 橋接器。

Xilinx UltraScale+ 器件提供:

  • 高達(dá) 1.5Gb/s 的 MIPI D-PHY 本地操作

  • 支持多達(dá) 4 個(gè) ARM Cortex?-A53 處理器的可擴(kuò)展處理能力

  • 業(yè)界最佳單位功耗性能比的 16nm 可編程邏輯

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原文標(biāo)題:[器件更新] Xilinx UltraScale+ 器件集成 MIPI D-PHY

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