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Vivado與ModelSim的聯合仿真操作

FPGA技術江湖 ? 來源:FPGA技術江湖 ? 作者:FPGA技術江湖 ? 2022-03-11 11:32 ? 次閱讀

Vivado自帶的仿真,個人覺得跑一些小模塊的仿真還是可以的,不過跑大的仿真系統,容易無體驗感,建議用第三方工具,這邊就直接對ModelSim下手了,接下來介紹下這兩者聯合仿真的操作。

首先確定下自己的Vivado版本和適配的ModelSim版本,可以在ug973中,找到對應的版本,比如我用的Vivado是2018.2的,然后匹配的ModelSim是10.6c的版本。(有時候版本不匹配也能用,不過還是建議盡量匹配版本的好,省得出一些奇怪的問題)

42b63cce-8a3d-11ec-952b-dac502259ad0.png

然后準備編譯仿真庫,打開Vivado,先打開Settings的仿真器配置 (注:我因為裝過多個版本,仿真器要換成最16.c的版本,不然編譯結果會因為版本不匹配出問題)

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42dc6b38-8a3d-11ec-952b-dac502259ad0.gif ModelSim的安裝路徑換成16.c版本的位置,庫路徑也設置好對應的位置,然后就可以OK保存并關閉了

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接著在菜單欄中選 Tools > Compile Simulation Libraries

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設置項里選好仿真器(此處為ModelSim),編譯后的仿真庫放置路徑(就填上面設置的那個新的仿真庫路徑),ModelSim程序的路徑,IP核編譯那項別取消了,是為了編譯Xlinx全部IP核的,其他項保持默認即可;TCL的命令就是根據這些配置生成的,然后點Compile就可以開始慢慢等編譯結果了。

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經過漫長的等待。。。。。。

結果出來了,檢查下結果.......

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ERROR: [Vivado 12-5603] compile_simlib failed to compile for modelsim with error in 1 library

看著紅彤彤的ERROR,心里有那么一絲絲小慌,然后往上翻,看看哪ERROR了

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查到是ldpc編碼的這個IP核出了問題,這個平常也沒用到,就直接無視這個錯誤了(要是你們的沒錯誤,就更好了,這個好像是因為系統是64位導致的,具體就懶得深究了)…… 如果是出現很多errors,就建議先檢查下版本是否匹配上了,不然也不會瘋狂報錯…… 就接著往下說吧~ 打開要仿真的工程,然后對打開Settings,因為創建的工程默認是用的自帶的仿真配置,所以需要改下仿真設置,首先將 Target simulator 改為 ModelSim Simulator,其次仿真庫的位置也需要檢查下是不是剛剛編譯好的庫對應的路徑,檢查無誤就可以點OK,開始后面的了

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42dc6b38-8a3d-11ec-952b-dac502259ad0.gif

直接運行仿真

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過一小會兒,Modelsim就被Vivado調用了,觀察窗口的輸出,正常無誤

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接著運行100us的仿真

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也能正常運行,聯合仿真OK~~ 最后補一點,假如自己不想編譯庫,想直接拿別人編好的,則拷貝好庫后,還需要對庫的初始化文件做對應的修改,找到庫路徑下的modelsim.ini(注:不要弄錯成ModelSim安裝路徑下的那個ini了),然后用編輯器打開

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可以看到這些庫都有以絕對路徑的形式鏈接,所以如果是從別的地方拷過來的,或者你打算換個路徑放仿真庫,那么就需要將舊的路徑改為新的路徑,然后其他的使用操作就和上面的一模一樣了。

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原文標題:Vivado與ModelSim的聯合仿真

文章出處:【微信號:HXSLH1010101010,微信公眾號:FPGA技術江湖】歡迎添加關注!文章轉載請注明出處。

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