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上拉電阻為何能上拉?下拉電阻為何能下拉?答案在此

貿(mào)澤電子設(shè)計(jì)圈 ? 來源:貿(mào)澤電子設(shè)計(jì)圈 ? 作者:貿(mào)澤電子設(shè)計(jì)圈 ? 2020-09-03 14:56 ? 次閱讀

在上拉電阻和下拉電阻的電路中,經(jīng)常有的疑問是:上拉電阻為何能上拉?下拉電阻為何能下拉?下拉電阻旁邊為何經(jīng)常會(huì)串一個(gè)電阻?

簡(jiǎn)單概括為:電源到器件引腳上的電阻叫上拉電阻,作用是平時(shí)使該引腳為高電平,地到器件引腳上的電阻叫下拉電阻,作用是平時(shí)使該引腳為低電平。低電平引腳在IC內(nèi)部與GND相連接;高電平引腳在IC內(nèi)部與超大電阻相連接。 上拉就是將不確定的信號(hào)通過一個(gè)電阻鉗位在高電平,電阻同時(shí)起限流作用,下拉同理。對(duì)于非集電極(或漏極)開路輸出型電路(如普通門電路),其提升電流和電壓的能力是有限的,上拉和下拉電阻的主要功能是為集電極開路輸出型電路提供輸出電流通道。上拉是對(duì)器件注入電流,下拉是輸出電流;強(qiáng)弱只是上拉或下拉電阻的阻值不同,沒有什么嚴(yán)格區(qū)分。 當(dāng)IC的I/O端口,節(jié)點(diǎn)為高電平時(shí),節(jié)點(diǎn)處和GND之間的阻抗很大,可以理解為無窮大,這個(gè)時(shí)候通過上拉電阻(如4.7KΩ,10KΩ電阻)接到VCC上,上拉電阻的分壓幾乎可以忽略不計(jì);當(dāng)I/O端口節(jié)點(diǎn)需要為低電平時(shí),直接接GND就可以了,這個(gè)時(shí)候VCC與GND是通過剛才的上拉電阻(如4.7KΩ,10KΩ電阻)連接的,通過的電流很小,可以忽略不計(jì)。 本文轉(zhuǎn)載自:電子發(fā)燒友網(wǎng) 免責(zé)聲明:本文為轉(zhuǎn)載文章,轉(zhuǎn)載此文目的在于傳遞更多信息,版權(quán)歸原作者所有。本文所用視頻、圖片、文字如涉及作品版權(quán)問題,請(qǐng)聯(lián)系小編進(jìn)行處理。 關(guān)于【M博士問答

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原文標(biāo)題:上拉電阻為什么能上拉?看完恍然大悟

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原文標(biāo)題:上拉電阻為什么能上拉?看完恍然大悟

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