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verilog中單/雙/三always塊狀態機寫法

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　　三段式結構中，2個時序always塊分別用來描述現態邏輯轉移，及輸出賦值。組合always塊用于描述狀態轉移的條件。這種結構是寄存器輸出，輸出無毛刺，而且代碼更清晰易讀，特別是對于復雜的狀態機來說，但是消耗的面積也更多點。這是一種比較流行的狀態機結構。


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